翻译一段中文成英文

Question

3熟悉主流FPGA和CPLD的内部结构，熟悉逻辑开发的全部流程，有高低端多种FPGA芯片的使用经验，擅长Linux环境下的逻辑仿真和验证。并且很擅长硬件调试，可很好的使用Candence(Allegro)和Protel（AD6）等软件。在图像分层处理、高速IO、Memory控制、DDS、LCD显示等方面有较多设计经验。并且有一定的DSP底层驱动开发能力。

工作经验：
2005年10月～2006年1月：于天津飞思卡尔半导体公司实习，主要负责芯片测试生产线的管理和芯片良品率提升。并在实习期间获优秀实习生奖章。
2006年3月～2008年9月：于北京普源精电科技有限公司（RIGOL），任逻辑工程师。在职期间曾参与过公司多个项目的研发工作。主要5项如下：
1． 数字信号发生器项目：该项目为迎合市场的特殊需要，以FPGA+SRAM为主构架，16路数字和16路模拟输出，输出SPI、I2C、RS232、PO、LIN等多种数字协议，其频率范围从0～120MHz不等，并有着多种触发输出方式。这个产品由我和一名硬件工程师合力完成，从最初的需求分析，详细设计，到后期硬件调试，生产问题追踪，再到维护和升级，进行全程参与和把握。
2． 函数信号发生器项目：该项目以冲击低端市场为目的，以DSP+SDRAM+FPGA+CPLD等芯片为数字部分主构架。与大多数信号发生器相似，该产品可输出各种基本信号和调制信号，频率为0～25MHz。该产品由五人合力完成，我负责该产品FPGA的80％工作，其中包括DDS控制，载波调制，与DSP的EBIU通讯，AD和DA控制等等内容。完整的参与了产品的研发、生产、上市各个阶段。该产品为公司创造了可观的收益。
3． 仪器通用显示卡项目：设计可以移植到公司内各种仪器上的通用显卡，以解脱DSP繁重的图像处理任务。通用显卡由三部分组成，FPGA+显存+LCD。我独立完成这个项目，是公司唯一的显卡开发人员。显卡特性包括，支持多个任意大小的图层，按任意位置和逻辑叠加，支持透明色和透明度设置，支持Gamma校正，支持SDRAM或DDR2做显存，并具有高达90％的显存带宽利用率。支持SPI、PPI、EBIU等控制接口，支持元太，京瓷，友达，夏普，东芝等多种液晶屏。并且该显卡已经在CycloneII、StratixII、Spartan3a、V5等多种FPGA上实现。并广泛用于公司上市仪器。
4． 四通道示波器项目：公司开拓四通道市场的首款产品。作为该项目组成员，我承担了40％的逻辑工作，包括CPLD控制，FGPA的主动配置，FPGA加密配置，FPGA与DSP的通讯，以及DDR2的驱动等。另外还负责设计所有DSP的底层驱动程序。完整的参与了产品研发的整个过程。
5． 高端示波器项目：该项目是公司推出的高端产品，我有幸参与其中，并负责完成了CPLD控制，666M高速DDR2接口，1G高速串行通讯（SERDES），1.2G采样AD数据处理，波形90度旋转，线性FFT运算，Pattern触发，SPI协议触发等等逻辑任务。该产品的推出，极大的稳固了RIGOL在国内测量行业的地位。
另：在职期间，搭建了FPGA专用仿真验证服务器，提高了公司逻辑人员的协作效率，并一直作为服务器rooter，协助配置管理员，管理CVS逻辑部分代码的更改和提交。在职期间曾先后获得公司优秀团队奖、优秀个人奖、优秀导师奖。

Answer 1

FPGA与CPLD的区别
系统的比较,与大家共享：
尽管FPGA和CPLD都是可编程ASIC器件,有很多共同特点,但由于CPLD和FPGA结构上的差异,具有各自的特点:
①CPLD更适合完成各种算法和组合逻辑,FP GA更适合于完成时序逻辑。换句话说,FPGA更适合于触发器丰富的结构,而CPLD更适合于触发器有限而乘积项丰富的结构。
②CPLD的连续式布线结构决定了它的时序延迟是均匀的和可预测的,而FPGA的分段式布线结构决定了其延迟的不可预测性。

③在编程上FPGA比CPLD具有更大的灵活性。CPLD通过修改具有固定内连电路的逻辑功能来编程,FPGA主要通过改变内部连线的布线来编程;FP GA可在逻辑门下编程,而CPLD是在逻辑块下编程。

④FPGA的集成度比CPLD高,具有更复杂的布线结构和逻辑实现。

⑤CPLD比FPGA使用起来更方便。CPLD的编程采用E2PROM或FASTFLASH技术,无需外部存储器芯片,使用简单。而FPGA的编程信息需存放在外部存储器上,使用方法复杂。

⑥CPLD的速度比FPGA快,并且具有较大的时间可预测性。这是由于FPGA是门级编程,并且CLB之间采用分布式互联,而CPLD是逻辑块级编程,并且其逻辑块之间的互联是集总式的。

⑦在编程方式上,CPLD主要是基于E2PROM或FLASH存储器编程,编程次数可达1万次,优点是系统断电时编程信息也不丢失。CPLD又可分为在编程器上编程和在系统编程两类。FPGA大部分是基于SRAM编程,编程信息在系统断电时丢失,每次上电时,需从器件外部将编程数据重新写入SRAM中。其优点是可以编程任意次,可在工作中快速编程,从而实现板级和系统级的动态配置。

⑧CPLD保密性好,FPGA保密性差。

⑨一般情况下,CPLD的功耗要比FPGA大,且集成度越高越明显。

随著复杂可编程逻辑器件(CPLD)密度的提高,数字器件设计人员在进行大型设计时,既灵活又容易,而且产品可以很快进入市场。许多设计人员已经感受到CPLD容易使用、时序可预测和速度高等优点,然而,在过去由于受到CPLD密度的限制,他们只好转向FPGA和ASIC。现在,设计人员可以体会到密度高达数十万门的CPLD所带来的好处。
CPLD结构在一个逻辑路径上采用1至16个乘积项,因而大型复杂设计的运行速度可以预测。因此,原有设计的运行可以预测,也很可靠,而且修改设计也很容易。CPLD在本质上很灵活、时序简单、路由性能极好,用户可以改变他们的设计同时保持引脚输出不变。与FPGA相比,CPLD的I/O更多,尺寸更小。

如今,通信系统使用很多标准,必须根据客户的需要配置设备以支持不同的标准。CPLD可让设备做出相应的调整以支持多种协议,并随著标准和协议的演变而改变功能。这为系统设计人员带来很大的方便,因为在标准尚未完全成熟之前他们就可以著手进行硬件设计,然后再修改代码以满足最终标准的要求。CPLD的速度和延迟特性比纯软件方案更好,它的NRE费用低於ASIC,更灵活,产品也可以更快入市。CPLD可编程方案的优点如下：
●逻辑和存储器资源丰富(Cypress Delta39K200的RAM超过480 Kb)
●带冗余路由资源的灵活时序模型
●改变引脚输出很灵活
●可以装在系统上后重新编程
●I/O数目多
●具有可保证性能的集成存储器控制逻辑
●提供单片CPLD和可编程PHY方案
由于有这些优点,设计建模成本低,可在设计过程的任一阶段添加设计或改变引脚输出,可以很快上市

CPLD的结构
CPLD是属於粗粒结构的可编程逻辑器件。它具有丰富的逻辑资源(即逻辑门与寄存器的比例高)和高度灵活的路由资源。CPLD的路由是连接在一起的,而FPGA的路由是分割开的。FPGA可能更灵活,但包括很多跳线,因此速度较CPLD慢。
CPLD以群阵列（array of clusters）的形式排列,由水平和垂直路由通道连接起来。这些路由通道把信号送到器件的引脚上或者传进来,并且把CPLD内部的逻辑群连接起来。

CPLD之所以称作粗粒,是因为,与路由数量相比,逻辑群要大得到。CPLD的逻辑群比FPGA的基本单元大得多,因此FPGA是细粒的。

CPLD的功能块
CPLD最基本的单元是宏单元。一个宏单元包含一个寄存器(使用多达16个乘积项作为其输入)及其它有用特性。
因为每个宏单元用了16个乘积项,因此设计人员可部署大量的组合逻辑而不用增加额外的路径。这就是为何CPLD被认为是“逻辑丰富”型的。

宏单元以逻辑模块的形式排列(LB),每个逻辑模块由16个宏单元组成。宏单元执行一个AND操作,然后一个OR操作以实现组合逻辑。

每个逻辑群有8个逻辑模块,所有逻辑群都连接到同一个可编程互联矩阵。
每个群还包含两个单端口逻辑群存储器模块和一个多端口通道存储器模块。前者每模块有8,192b存储器,后者包含4,096b专用通信存储器且可配置为单端口、多端口或带专用控制逻辑的FIFO。

CPLD有什麽好处？
I/O数量多
CPLD的好处之一是在给定的器件密度上可提供更多的I/O数,有时甚至高达70%。
时序模型简单
CPLD优于其它可编程结构之处在于它具有简单且可预测的时序模型。这种简单的时序模型主要应归功于CPLD的粗粒度特性。
CPLD可在给定的时间内提供较宽的相等状态,而与路由无关。这一能力是设计成功的关键,不但可加速初始设计工作,而且可加快设计调试过程。

粗粒CPLD结构的优点
CPLD是粗粒结构,这意味著进出器件的路径经过较少的开关,相应地延迟也小。因此,与等效的FPGA相比,CPLD可工作在更高的频率,具有更好的性能。
CPLD的另一个好处是其软件编译快,因为其易于路由的结构使得布放设计任务更加容易执行。

细粒FPGA结构的优点
FPGA是细粒结构,这意味著每个单元间存在细粒延迟。如果将少量的逻辑紧密排列在一起,FPGA的速度相当快。然而,随著设计密度的增加,信号不得不通过许多开关,路由延迟也快速增加,从而削弱了整体性能。CPLD的粗粒结构却能很好地适应这一设计布局的改变。

灵活的输出引脚
CPLD的粗粒结构和时序特性可预测,因此设计人员在设计流程的后期仍可以改变输出引脚,而时序仍保持不变。

为什么CPLD和FPGA需要不同的逻辑设计技巧？
FPGA是细粒器件,其基本单元和路由结构都比CPLD的小。FPGA是“寄存器丰富”型的(即其寄存器与逻辑门的比例高),而CPLD正好相反,它是“逻辑丰富”型的。

很多设计人员偏爱CPLD是因为它简单易用和高速的优点。CPLD更适合逻辑密集型应用,如状态机和地址解码器逻辑等。而FPGA则更适用于CPU和DSP等寄存器密集型设计。

新的CPLD封装
CPLD有多种密度和封装类型,包括单芯片自引导方案。自引导方案在单个封装内集成了FLASH存储器和CPLD,无须外部引导单元,从而可降低设计复杂性并节省板空间。在给定的封装尺寸内,有更高的器件密度共享引脚输出。这就为设计人员提供了“放大”设计的便利,而无须更改板上的引脚输出。

CPLD的功耗
与同样密度的FPGA相比,CPLD的待机功耗更低。

CPLD FPGA （待机电流（在Vcc 为1.8V时））
50K 300μA 200mA
100K 600μA 200mA
200K 1.25mA 300mA

CPLD特别适合那些要求低功耗和低温度的电池供电应用,像手持设备。

许多设计人员都熟悉传统的PLD,并喜欢这种结构所固有的灵活性和易用性。CPLD为ASIC和FPGA设计人员提供了一种很好的替代方案,可让他们以更简单、方便易用的结构实现其设计。CPLD现已达到数十万门的密度,并可提供当今通信设计所需的高性能。大于50万门的设计仍需ASIC和FPGA,但对于小型设计,CPLD不失为一个高性价比的替代方案。

FPGA采用了逻辑单元阵列LCA（Logic Cell Array）这样一个新概念,内部包括可配置逻辑模块CLB（Configurable Logic Block）、输出输入模块IOB（Input Output Block）和内部连线（Interconnect）三个部分。FPGA的基本特点主要有：
1）采用FPGA设计ASIC电路,用户不需要投片生产,就能得到合用的芯片。 ——2）FPGA可做其它全定制或半定制ASIC电路的中试样片。
3）FPGA内部有丰富的触发器和I／O

参考资料：希望采纳

Answer 2

By
using
the
meterial
of
the
year
2008
from
Xuanwu
Merterology
Observation
Station,
we
analysed
and
evaluated
the
year's
temperature,
rainfall,and
sunshine
factor
as
well
as
their
effects.
The
result
had
it
that
the
annual
averge
tempreture
was
a
littlelower
than
perennial
temperture(long
time
of
continious
low
temperture
wether
in
Jan-Feb
);
the
annual
rainfall
was
a
little
more
than
perennial
level
but
in
a
uneven
distributed
way;
the
annual
sunshine
also
slightly
exceed
prennial
situation
and
also
distributed
unevenly
throughout
the
year.
The
climate
characteristics
of
2008
exertedmore
benefit
than
harm
to
the
early
season
rice,
so
it
wasa
relatively
goodod
year.
It's
also
a
good
year
to
the
growth
and
maturity
to
late
season
rice.
But
it's
not
so
good
for
the
growth
of
sugar
cane.
From
March
on,
it
tended
to
be
a
good
year.
In
terms
of
people's
life
health
and
transportation,
it
was
a
good
year.
自翻译反机译

Answer 3

3 familiar with the mainstream FPGA and CPLD's internal structure, logic familiar with the development of the whole process, there is a high low-end FPGA chips use a variety of experiences, good Linux environment, the logic simulation and verification. And very good at hardware debugger can be a very good use of Candence (Allegro) and Protel (AD6), and other software. In the hierarchical image processing, high-speed IO, Memory control, DDS, LCD display, and so on have more experience in the design. And a certain degree of DSP development of the ability to drive the bottom.

Work experience:
In October 2005 to January 2006: Tianjin Freescale Semiconductor internship, is mainly responsible for testing the chip production line management and improve chip yield. And in practice have been outstanding during the medal intern.
In March 2006 to September 2008: Beijing RIGOL Technology Co., Ltd. (RIGOL), the logic of Engineers office. During the on-the-job companies have participated in a number of research and development projects. The main 5 are as follows:
1. Digital signal generator project: the project to meet the special needs of the market in order to FPGA + SRAM-based architecture, 16 analog and 16 digital output, output SPI, I2C, RS232, PO, LIN and other figures, the frequency Ranging from 0 ~ 120MHz range, and has triggered a variety of output. The product from a hardware engineer and I together, from the initial needs analysis, detailed design, the latter part of the hardware debugger, production tracking, maintenance and upgrade to, and take part in the entire process.
2. Function Generator: the impact of the project to low-end market, by DSP + SDRAM + FPGA + CPLD, such as chips for the digital part of the main framework. Unlike most similar to the signal generator, which can output signals and basic signal modulation, the frequency of 0 ~ 25MHz. The effort by the five-member, I am responsible for the FPGA 80% of the products, including DDS control, modulation, and EBIU of DSP Communications, AD and DA control of the content, and so on. The integrity of the products involved in the research and development, production, listing the various stages. The company has created a handsome gains.
3. General Instrument display card: the design can be transferred to the company on a variety of instruments common graphics cards, in order to escape the heavy DSP image processing tasks. Universal card consists of three parts, FPGA + memory + LCD. I completed an independent project, the company is the sole developer of graphics cards. Graphics features include support for multiple layers of any size, anywhere and by the logic of superposition, and support for transparent color transparency settings, support for the Gamma Correction, or SDRAM support DDR2 memory to do with as much as 90% of the memory bandwidth utilization Rate. Support for SPI, PPI, EBIU such as the control interface, support for the yuan too, Kyocera, the Friends of the up, Sharp, Toshiba and other LCD screens. And the graphics have been CycloneII, StratixII, Spartan3a, V5 and other FPGA to achieve. And is widely used in the company's listed instruments.
4. Four-channel oscilloscope: the company to open up the market's first four-channel products. As part of the project team members, I assumed 40% of logic, including the CPLD control, FGPA active configuration, FPGA configuration encryption, FPGA and DSP communications, as well as DDR2 and so on the drive. It was also responsible for the design of all the underlying drivers of the DSP. The integrity of the products involved in the research and development of the whole process.
5. High-end oscilloscope project: The project is the introduction of high-end products, of which I was privileged to participate and be responsible for the completion of the CPLD control, 666M high-speed DDR2 interface, 1G high-speed serial communication (SERDES), 1.2G sampling AD data processing, waveform 90 Degree rotation, linear FFT computation, Pattern trigger, SPI protocol triggering and so on the logic of the task. The product's launch, a great deal of solid RIGOL measured in the domestic industry.
Another: on-the-job, set up a dedicated FPGA simulation servers, the company increased the efficiency of the logic of staff collaboration, as a server and has been rooter, to help administrators to configure, manage CVS part of the logic of the code and submit changes. Has access to on-the-job during the team's outstanding Award, outstanding individual award, outstanding mentor award.
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