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VHDL语言中 BEGIN、END、IF、ELSE、ELSIF是怎么用的啊? 高手详解(通俗易懂)。谢谢!!!
如题所述
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推荐答案 推荐于2017-09-16
begin时开始的意是,用在
结构体
中,进程下面也要有begin,end是结束的意思,实体,结构体及其他的语句都需要在尾端用END来结束,if,else,elsif都是顺序描述语句
if语句
里面
单分支if语句
if 条件 then
顺序语句;
end if;
二分支if语句
if 条件 then
顺序语句;
else
顺序语句;
end if;
多分支if语句
if 条件1 then
顺序语句;
elsif 条件2 then
顺序语句;
......
else
顺序语句;
end if;
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帮忙解读下,急
用啊
谢谢!!!
答:
elsif
a1>=((n+1)/2-1) then temp1:='0';a1:=a1+1;---
else
如果这个条件满足 a1自加1,temp1赋值0;
end
if; --结束 end if; --结束 if falling_edge(clock) then 判断时钟下降沿 ,具体同上面。if a2=n-1 then a2:=0;temp2:='0';elsif a2<((n+1)/2-1) then temp...
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IF怎么用
求
详解
可以追加...
答:
IF(
条件)THEN (顺序语句);
ELSIF(
条件)THEN (顺序语句);……
ELSE
(顺序语句);
END
IF;建议你弄本书来看啊
,VHDL
其实还是蛮复杂的,老师说会越来越觉得复杂的~
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